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TDA10023是一个单芯片的DVB-C信道接收器4，16，32，64，128和256-QAM调制信号。
设备接口直接中频信号，这是由一个10位A / D转换器采样。
的的TDA10023执行的时钟和载波恢复功能。时钟和数字环路滤波器
载波恢复是可编程的，以优化他们的特点，根据当前的应用程序。
基带转换后，均衡滤波器用于电缆应用中的回声取消。这些过滤器
的T-行距横向均衡器或DFE的均衡配置，使系统的性能可以
根据网络的特点优化。一个专有的均衡算法，独立承运人
偏移，实现以协助载波恢复。然后定向算法决定发生，实现
终的均衡收敛。
TDA10023芯片实现了一个FEC解码器。 DVB-C模式的TDA10023实现了福内
卷积deinterleaver深度12块和8错误纠正一个Reed-Solomon解码器
字节。在deinterleaver和RS解码器的自动同步帧同步
算法，它使用的MPEG2同步字节。在取得根据DVB-C标准的解扰
里德所罗门输出。
此设备的控制通过一个I
2
C总线。

1特点
4/16/32/64/128/256 QAM解调器（的ITU-T J.83附录A和C兼容）。
高性能256 QAM的，特别是直接中频应用。
在芯片的10位ADC。
片上PLL（通常为16MHz晶体）晶体倍频。
数字下变频。
半奈奎斯特滤波器（擀关闭= 0.15）。
两个PWM AGC输出多点与可编程起飞（调谐器和下变频器控制）。
时钟定时恢复，可编程二阶环路滤波器。
可变符号率从SACLK/64 SACLK/ 4的能力（低采样时钟：SACLK值=36
MHz）或，从SACLK/128/ 8 SACLK（高采样时钟：SACLK= 72兆赫）。
可编程抗混叠滤波器。
全数字载波恢复环路。
载波收购范围符号率至9％。
集成的自适应均衡器（线性横向均衡器或判决反馈均衡器）。
DVB兼容差分译码和映射。
在芯片的DVB-C标准的FEC解码器（Deinterleaver，RS解码器，Descrambleur）。
多个TS JQAM过滤器。
并行和串行同步传输流接口。
2C总线接口，易于控制。