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深圳市广辉电子有限公司
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产品信息
1. Altera 公司PLD 器件简介
PLD 是用简单逻辑结构完成任何布尔表
达式及存储功能的器件。由于它的灵活性, 特
别是目前制造工艺技术不断改进且价格降低,
使它的应用越来越广泛。Altera 公司自1983 年
以来一直从事PLD 的研究与制造。从器件结构
来看, PLD 包括: PAL , GAL , FPGA , CPLD
(Complex PLD) 。严格地讲, Altera 公司PLD
只是PLD 家族中的一部分, 属于CPLD 。从
1984 年Altera 公司发明的世界首块EPLD —
EP300 问世以来, 该公司已相继推出了七种系
列器件: Classic , MAX5000/ EPS464 ,
MAX6000 ,MAX7000 ,MAX9000 , FLASHlo g2
ic ,FL EX8000 。这些器件从不同的结构、工艺以
及存储技术上来满足各种设计的要求。
Classic , MAX5000/ EPS464 , MAX6000 ,
MAX7000 , MAX9000 , FLASHlo gic 系列均为
EPLD , 它们采用积- 和(sum - of - p roduct s)
结构, 主要用于组合逻辑设计, 它的逻辑密度可
从150 个使用门到12000 个使用门, 有20 到
216个引脚。MAX7000 系列是Altera 公司1992
年来推出的高密度器件, 它结合了FPGA 器件
高密度的优点, 使用LU T(look - up - table) 查
寻表结构,逻辑密度量可达到600～5000 个使用
门,用户可使用的引脚数从36 到164 个,适用于
有大量寄存器的高密度系统设计。
2. MAX7000 器件的特点和结构
2. 1 MAX7000 系列器件特点
(1) 以第二代多阵列矩阵为基础的高性能
CMOS EPROM 器件;
(2) 逻辑密度为600～5000 个可用门(器件
上提供1200～10000 个门) 的全EPLD 系列;
(3) 引脚到引脚的逻辑延时为5ns , 计数器
工作频率为178. 6MHz ;
(4) 可编程功率节省模式,使每个宏单元的
功耗降低到50 %或更低;
(5) 遵守PCI ( - 7 和- 10P) 规定;
(6) 可配置的扩展乘积项分配,允许向每个
宏单元提供多达32 个乘积项;
(7) 44 到208 个引脚的各式封装;
(8) 3. 3V 或5. 0V 电源;
(9) 可编程保密位,全面保护设计;
(10) 可编程触发器具有单独的清除、置位、
时钟使能控制;
(11) Altera MAX + Plus Ⅱ开发系统提供
软件设计支持, 该开发系统可工作在486PC
机、奔腾PC 机、SunSPARC 工作站、HP9000
系列700 工作站或DEC Alp ha AXP 工作站
上;
(12) Altera 主编程部件(MPU) 或其它厂
PLD 是用简单逻辑结构完成任何布尔表
达式及存储功能的器件。由于它的灵活性, 特
别是目前制造工艺技术不断改进且价格降低,
使它的应用越来越广泛。Altera 公司自1983 年
以来一直从事PLD 的研究与制造。从器件结构
来看, PLD 包括: PAL , GAL , FPGA , CPLD
(Complex PLD) 。严格地讲, Altera 公司PLD
只是PLD 家族中的一部分, 属于CPLD 。从
1984 年Altera 公司发明的世界首块EPLD —
EP300 问世以来, 该公司已相继推出了七种系
列器件: Classic , MAX5000/ EPS464 ,
MAX6000 ,MAX7000 ,MAX9000 , FLASHlo g2
ic ,FL EX8000 。这些器件从不同的结构、工艺以
及存储技术上来满足各种设计的要求。
Classic , MAX5000/ EPS464 , MAX6000 ,
MAX7000 , MAX9000 , FLASHlo gic 系列均为
EPLD , 它们采用积- 和(sum - of - p roduct s)
结构, 主要用于组合逻辑设计, 它的逻辑密度可
从150 个使用门到12000 个使用门, 有20 到
216个引脚。MAX7000 系列是Altera 公司1992
年来推出的高密度器件, 它结合了FPGA 器件
高密度的优点, 使用LU T(look - up - table) 查
寻表结构,逻辑密度量可达到600～5000 个使用
门,用户可使用的引脚数从36 到164 个,适用于
有大量寄存器的高密度系统设计。
2. MAX7000 器件的特点和结构
2. 1 MAX7000 系列器件特点
(1) 以第二代多阵列矩阵为基础的高性能
CMOS EPROM 器件;
(2) 逻辑密度为600～5000 个可用门(器件
上提供1200～10000 个门) 的全EPLD 系列;
(3) 引脚到引脚的逻辑延时为5ns , 计数器
工作频率为178. 6MHz ;
(4) 可编程功率节省模式,使每个宏单元的
功耗降低到50 %或更低;
(5) 遵守PCI ( - 7 和- 10P) 规定;
(6) 可配置的扩展乘积项分配,允许向每个
宏单元提供多达32 个乘积项;
(7) 44 到208 个引脚的各式封装;
(8) 3. 3V 或5. 0V 电源;
(9) 可编程保密位,全面保护设计;
(10) 可编程触发器具有单独的清除、置位、
时钟使能控制;
(11) Altera MAX + Plus Ⅱ开发系统提供
软件设计支持, 该开发系统可工作在486PC
机、奔腾PC 机、SunSPARC 工作站、HP9000
系列700 工作站或DEC Alp ha AXP 工作站
上;
(12) Altera 主编程部件(MPU) 或其它厂